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EMC2302 Fiches technique(PDF) 27 Page - Microchip Technology |
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EMC2302 Fiches technique(HTML) 27 Page - Microchip Technology |
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27 / 70 page  2021 Microchip Technology Inc. DS20006532A-page 27 EMC2301/2/3/5 TACH 3 Reading High Byte 5Eh F3TR12 F3TR11 F3TR10 F3TR9 F3TR8 F3TR7 F3TR6 F3TR5 No FFh TACH 3 Reading Low Byte 5Fh F3TR4 F3TR3 F3TR2 F3TR1 F3TR0 — — —No F8h Fan 4 Setting 60h F4SP7 F4SP6 F4SP5 F4SP4 F4SP3 F4SP2 F4SP1 F4SP0 No 00h PWM 4 Divide 61h PM4D7 PM4D6 PM4D5 PM4D4 PM4D3 PM4D2 PM4D1 PM4D0 No 01h Fan 4 Configuration 1 62h ENAG4 RNG41 RNG40 EDG41 EDG40 UDT42 UDT41 UDT40 No 2Bh Fan 4 Configuration 2 63h — ENRC4 GHEN4 DPT41 DPT40 ERG41 ERG40 —SWL 28h Gain 4 65h — — GDE41 GDE40 GIN41 GIN40 GPR41 GPR40 SWL 2Ah Fan 4 Spin Up Configuration 66h DFC41 DFC40 NKCK4 SPLV42 SPLV41 SPLV40 SPT41 SPT40 SWL 19h Fan 4 Max Step 67h — — F4MS5 F4MS4 F4MS3 F4MS2 F4MS1 F4MS0 SWL 10h Fan 4 Minimum Drive 68h F4MN7 F4MN6 F4MN5 F4MN4 F4MN3 F4MN2 F4MN1 F4MN0 SWL 66h (40%) Fan 4 Valid TACH Count 69h F4VT7 F4VT6 F4VT5 F4VT4 F4VT3 F4VT2 F4VT1 F4VT0 SWL F5h Fan 4 Drive Fail Band Low Byte 6Ah F4DF4 F4DF3 F4DF2 F4DF1 F4DF0 — — —SWL 00h Fan 4 Drive Fail Band High Byte 6Bh F4DF12 F4DF11 F4DF10 F4DF9 F4DF8 F4DF7 F4DF6 F4DF5 SWL 00h TACH 4 Target Low Byte 6Ch F4TT4 F4TT3 F4TT2 F4TT1 F4TT0 — — —No F8h TACH 4 Target High Byte 6Dh F4TT12 F4TT11 F4TT10 F4TT9 F4TT8 F4TT7 F4TT6 F4TT5 No FFh TACH 4 Reading High Byte 6Eh F4TR12 F4TR11 F4TR10 F4TR9 F4TR8 F4TR7 F4TR6 F4TR5 No FFh TACH 4 Reading Low Byte 6Fh F4TR4 F4TR3 F4TR2 F4TR1 F4TR0 — — —No F8h Fan 5 Setting 70h F5SP7 F5SP6 F5SP5 F5SP4 F5SP3 F5SP2 F5SP1 F5SP0 No 00h PWM 5 Divide 71h PM5D7 PM5D6 PM5D5 PM5D4 PM5D3 PM5D2 PM5D1 PM5D0 No 01h Fan 5 Configuration 1 72h ENAG5 RNG51 RNG50 EDG51 EDG50 UDT52 UDT51 UDT50 No 2Bh Fan 5 Configuration 2 73h — ENRC5 GHEN5 DPT51 DPT50 ERG51 ERG50 —SWL 28h Gain 5 75h — — GDE51 GDE50 GIN51 GIN50 GPR51 GPR50 SWL 2Ah Fan 5 Spin Up Configuration 76h DFC51 DFC50 NKCK5 SPLV52 SPLV51 SPLV50 SPT51 SPT50 SWL 19h Fan 5 Max Step 77h — — F5MS5 F5MS4 F5MS3 F5MS2 F5MS1 F5MS0 SWL 10h Fan 5 Minimum Drive 78h F5MN7 F5MN6 F5MN5 F5MN4 F5MN3 F5MN2 F5MN1 F5MN0 SWL 66h (40%) Fan 5 Valid TACH Count 79h F5VT7 F5VT6 F5VT5 F5VT4 F5VT3 F5VT2 F5VT1 F5VT0 SWL F5h TABLE 6-1: REGISTER SET IN HEXADECIMAL ORDER (CONTINUED) Register Name Reg. Addr. Bit 7Bit 6Bit 5Bit 4Bit 3Bit 2Bit 1Bit 0 Lock POR Value |
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