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RA4M1 Fiches technique(PDF) 77 Page - Renesas Technology Corp |
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77 / 131 page ![]() R01DS0355EJ0110 Rev.1.10 Page 77 of 131 Sep 29, 2023 RA4M1 Group 2. Electrical Characteristics Figure 2.52 SPI clock timing Figure 2.53 SPI timing for master when CPHA = 0 and the bit rate is set to any value other than PCLKA/2 RSPCKn master select output RSPCKn slave select input tSPCKWH VOH VOH VOL VOL VOH VOH tSPCKWL tSPCKr tSPCKf VOL tSPcyc tSPCKWH VIH VIH VIL VIL VIH VIH tSPCKWL tSPCKr tSPCKf VIL tSPcyc VOH = 0.7 × VCC, VOL = 0.3 × VCC, VIH = 0.7 × VCC, VIL = 0.3 × VCC n = A or B tDr, tDf tSU tH tLEAD tTD tLAG tSSLr, tSSLf tOH tOD M SB IN D ATA LSB IN M SB IN M SB O UT DATA LSB OU T ID LE M SB OU T SSLn0 to SSLn3 output RSPCKn CPOL = 0 output RSPCKn CPOL = 1 output MISO n input MOSIn output n = A or B |
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