ST72321J9-Auto datasheet(3/243 Pages) STMICROELECTRONICS

3 / 243 page

ST72321xx-Auto

Contents

Doc ID 13829 Rev 1

3/243

6.4

Multi-oscillator (MO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

6.5

Reset sequence manager (RSM) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40

6.5.1

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40

6.5.2

Asynchronous external RESET pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41

6.5.3

External power-on RESET . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41

6.5.4

Internal low voltage detector (LVD) RESET . . . . . . . . . . . . . . . . . . . . . . 41

6.5.5

Internal watchdog RESET . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42

6.6

System integrity management (SI) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43

6.6.1

Low voltage detector (LVD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43

6.6.2

Auxiliary voltage detector (AVD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

6.6.3

Low power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

6.6.4

Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

6.6.5

System Integrity (SI) Control/Status register (SICSR) . . . . . . . . . . . . . . 47

Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49

7.1

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49

7.2

Masking and processing flow . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49

7.3

Interrupts and low power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52

7.4

Concurrent and nested management . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52

7.5

Interrupt register description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53

7.5.1

CPU CC register interrupt bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53

7.5.2

Interrupt software priority registers (ISPRx) . . . . . . . . . . . . . . . . . . . . . . 54

7.6

External interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57

7.6.1

I/O port interrupt sensitivity . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57

7.6.2

External interrupt control register (EICR) . . . . . . . . . . . . . . . . . . . . . . . . 59

Power saving modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

8.1

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

8.2

Slow mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

8.3

Wait mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

8.4

Active Halt and Halt modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65

8.4.1

Active Halt mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65

8.4.2

Halt mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67

I/O ports . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70

9.1

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70

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