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HIP1012ACB Fiches technique(PDF) 2 Page - Intersil Corporation |
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HIP1012ACB Fiches technique(HTML) 2 Page - Intersil Corporation |
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2 / 15 page  Simplified Block Diagram 2V VDD 12VG 12VS 12ISEN 5VG 5VS 5ISEN GND PWRON1 CTIM PGOOD RILIM CPUMP PWRON2 QPUMP 100µA RISING ENABLE VDD R R S QN Q POR CLIM 3X ENABLE OC 10µA OPTIONAL FALLING EDGE DELAY R 2R EDGE RESET RFILTER CFILTER CPUMP CTIM RILIM 12V TO LOAD TO LOAD OC OPTIONAL LATCH 12VIN 5VIN 10µA 12V HIP1012A CGATE 20Ω CGATE 20 Ω TO VDD + - 12V + - RSENSE + - PGOOD + - CLIM 3X ENABLE OC FALLING EDGE DELAY R 2R 18V + - 18V + - 12V RSENSE |
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