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UPD6376GS Fiches technique(PDF) 13 Page - Renesas Technology Corp |
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13 / 22 page ![]() TIMING CHART 2 • When Pin 1 is High (parallel input) tSCK tSCK CLK SI tCD tDC CLK WDCK tDC tCD 4.5 clocks LSB CLK LSI RSI WDCK L.OUT R.OUT 16 1 2 3 4 5 6789 10 11 12 13 14 15 16 MSB LSB N 1 2 3 4 5 6789 10 11 MSB N–1N LSB 16 1 2 3 4 5 6789 10 11 12 13 14 15 16 MSB LSB N N + 1 1 2 3 4 5 6789 10 11 MSB N–1N Analog output update |
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