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GS816272CC Fiches technique(PDF) 4 Page - GSI Technology |
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4 / 31 page ![]() GS816272CC-333/300/250/200/150 Preliminary Specifications cited are subject to change without notice. For latest documentation see http://www.gsitechnology.com. Rev: 1.01 2/2005 4/31 © 2004, GSI Technology GS816272C Block Diagram A1 A0 A0 A1 D0 D1 Q1 Q0 Counter Load DQ DQ Register Register DQ Register DQ Register DQ Register DQ Register DQ Register DQ Register A0–An LBO ADV CK ADSC ADSP GW BW FT G ZZ Power Down Control Memory Array 36 36 4 A QD DQx1–DQx9 36 36 Note: Only x36 version shown for simplicity. SCD 36 36 BA BB BC BD E1 E3 E2 |
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